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Zynq 相关问答

社区里带 Zynq 标签的 40 条问答,按原帖浏览量排序,逐条给出中文要点与原帖链接。

Petalinux从SD卡启动在U-Boot中停止并报神秘错误
问题未解决,根因未确定
裸机Hello World链接报未定义_exit等符号
不用BSP时需自行实现libc依赖的底层函数或改用rdimon.specs
Zynq PS CAN 经 MIO 外接收发器无法通信且 BUS-OFF
修正电平转换 IC 连接后 CAN 通信恢复正常
Vitis编译Zynq Linux应用报错找不到zynq_fsbl.elf
可单独build application规避,或用bootgen命令自行生成
ZYNQ Z7045上无法修改以太网Ring参数
改用Petalinux v2020.2的MACB驱动后即可修改以太网缓冲区设置
ZC706上无Zynq IP时如何运行MicroBlaze代码?
开发阶段调试器可烧写FPGA,但该向导下载方式需PS,帖中未给出最终解决办法
Zynq平台内核解压后挂起无法启动
调整加载地址后曾成功启动,但根因未确认
Zynq Flash启动JFFS2报Magic bitmask错误
分区重复已确认,但JFFS2 Magic错误根因帖中未给出结论
按UG1186配置OpenAMP后Zybo启动失败
调整预留内存地址避开冲突后启动恢复正常
Zynq自定义IP实现报错IOCNT-2 HP/HR IO数量超限
需减少连接到IO的IP示例端口以适配XC7Z020的HP/HR IO数量
AXI-PCIe驱动probe失败如何解决?
连接interrupt_out到PS中断并使能PL-PS中断端口后问题解决
Zynq Linux镜像启动报wrong image format
手动fatload后bootz可启动,但自动启动问题帖中未解决
ZYNQ XC7Z015开发板JTAG只能识别FPGA无法识别ARM DAP
更换芯片后恢复正常,疑似翻新芯片导致
PetaLinux加载dma-pl330驱动后挂起
需确认SDHC接口并注意PL330驱动不适用于AXI DMA
PetaLinux 2020.2 构建 Zynq 7045 时 glibc 版本不匹配怎么办?
需在受支持的操作系统上构建,避免 glibc 版本不匹配。
Vitis 2021.2 构建 Zynq R5 DPDMA 示例报 nearbyint 未定义
nearbyint() 属于数学库,帖中未给出最终修复结论
Vitis 2020.1 自定义IP驱动链接报错
帖中未给出明确根因与解决方案
用SDK生成FSBL时报xuartps_hw.h找不到
提问者用SDK建FSBL工程仍报同样错误,帖中无最终解决方案
axi_uartlite IP核引脚约束报错如何解决
按UART位于PS还是PL选择正确配置方式
Zynq GPIO_EMIO出现IBUFCTRL未布局错误如何解决
inout双向端口应在顶层例化IOBUF,需核查assign逻辑
Zynq 7035 PS DDR3L 初始化失败如何排查
DDR 初始化失败原因未定位,需提供 dram_test 运行日志
PetaLinux 2024.1 SD卡启动image.ub卡在console enabled
修正BOOT.BIN地址偏移并重跑petalinux-build后SD卡启动正常
擦除flash文件系统分区后kernel为何起不来
擦除文件系统分区后kernel无法启动,根因帖中未明确
AXI VDMA通过HDMI显示图像出现间歇性异常,是缓存问题吗?
根因未确认,回答者推测为带宽与时钟树问题
ZyNQ 2023.1 QEMU下TPG到帧缓冲写yavta采集报flush未完成
多种修改后问题仍存在,帖中未给出结论
Zynq 7030 Petalinux 内核启动卡在 OCM 初始化
PL 外部时钟未启动导致内核启动挂起,改用 PS PLL 或提前配置外部时钟可解决
Zynq RSA认证SPK Signature校验失败如何解决
需在bif中正确提供spksignature,具体生成方法帖中未明确
XAPP1078创建FSBL_AMP报xget_processor_name错误
多位用户在不同版本复现该错误,帖中未给出解决方案
自定义IP的AXI Stream与AXI DMA传输问题
问题未解决,作者另开新帖继续讨论
MIPI CSI2 Rx IP 的每时钟像素数为何硬编码为4?
可在 IP GUI 中修改并重新生成,但移植报错原因未明确。
Petalinux SD卡启动出现不支持命令错误
问题未解决,bootrom错误码0x00400000在Zynq用户指南中未定义
Vivado下载PL报labtools 27-3165错误怎么办
提问者被建议查阅两个相关旧帖,帖中未给出明确结论
3-TAP相机经VDMA显示图像异常如何排查?
3-TAP数据未拆分导致只显示1/3图像,拆分后完整显示
Vitis工程迁移后makefile仍指向旧路径如何修改
帖中未给出有效解决方案
PetaLinux 2021.2 升级后 Zynq 无法启动且串口无输出
升级到 2021.2 后无法启动,帖中未给出原因和解决方案
ZYNQ同时用USB0和USB1时USB1无法配置为gadget ethernet
问题源于USB3320芯片无时钟输出,非设备树配置问题
JTAG烧写bitstream报PL电源关闭错误
问题已修复,提问者称根因是烧写bitstream后掉电
Vivado 2021.1 对 ZYNQ XC7Z020 编程 Efuse 是否有问题?
问题未解决,发帖人暂停操作以免第三块板变砖
FSBL_PPK_FAILURE_ERROR 是什么问题?
BOOTROM 验证 FSBL PPK 失败,根因尚未确定
Vivado 2023.2 运行连接自动化报错 lnoc_da 变量不存在
用户卸载 2023.2 改用 2023.1 后错误消失

相关标签

PetaLinux 11FSBL 7U-Boot 6Vitis 6Vivado 5SD boot 3JTAG 3custom IP 3QSPI 2eFUSE 2AXI DMA 2device-tree 2

只做要点整理、非原文转载;帖中没给出结论的标注「社区未闭环」,技术细节以原帖与 AMD 官方文档为准。

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