DDR / MIG社区未闭环原帖 9 个回答 · 919 次浏览|器件:Vivado 2022.1 / ZCU102(错误码:Netlist 29-160; Mig 66-99; Opt 31-306)
一句话结论:按回答者建议用 Board Parts 建简单设计可正常实现
综合与实现报 OUTPUT_IMPEDANCE 属性不存在及 MIG 时钟端口未放置错误
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E000079oj1NSAQ/implementation-is-failing-in-vivado-20221-for-in
相关标签:Vivado · ZCU102 · DDR4 · MIG
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