DDR / MIG已闭环原帖 9 个回答 · 531 次浏览|器件：XCZU7EV / MIG / DDR4 RDIMM
一句话结论：修正自定义csv时序参数后内存测试通过，问题源于参数配置而非板级布局或电源
MIG校准无错误，但写入后读回数据不一致，多次读取结果不同
自定义parts csv文件中时序参数（如CAS latency）设置错误，与所选速度等级/工作速率不匹配
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D54U00006KoLwVSAV/i-am-bringing-up-a-new-board-with-the-xczu7ev-pa
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