封装与引脚约束社区未闭环原帖 9 个回答 · 852 次浏览|器件:Vitis / xclbin / vpl
一句话结论:帖中给出若干建议但提问者未确认解决,根因未明确
xclbin构建在逻辑布局阶段失败,工具试图把单元外的逻辑也放入pblock
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E000075Yn9LSAS/how-to-use-pblock-to-lock-down-a-cell-inside-a-r
相关标签:pblock · RTL_kernel · Vitis · place_design
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