AXI 互联 / Stream社区未闭环原帖 4 个回答 · 390 次浏览|器件:原帖未注明
一句话结论:需确认tvalid连接并在各AXIS接口加ILA排查
两路16位数据经AXI Stream Combiner合并后,最终输出只有其中一路
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D54U00007UnB1wSAF/hii-have-two-16-bits-data-and-i-want-to-merge-th
相关标签:AXI Stream · Combiner · tvalid · ILA
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