Vivado 报错与许可已闭环原帖 8 个回答 · 396 次浏览|器件：Vivado 2021.2 / xcvu095-ffva2104-2-e / VHDL
一句话结论：移除未使用的DDR4 IP块后综合成功
综合几分钟后显示红色synthesis failed，无错误信息和关键警告
未使用的DDR4 IP块内容异常，可能被优化阶段删除导致综合失败
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E000077r6ndSAA/hi-when-i-synthesize-my-design-it-processes-for-
该问题涉及的器件系列（点进去看同系列其他踩坑记录）：
Virtex UltraScale+ →相关标签：Vivado · synthesis · IP · DDR4
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