重建工程后BD中RTL模块连接丢失
IP 与 Block Design 已闭环 Vivado 2020.2 / Windows
一句话结论:该问题为2020.2已知缺陷,升级到2021.1及以上版本可修复
仅保留.xpr和.srcs重建工程后,BD中RTL模块连接消失并报BD 41-2162
2020.2已知问题,仅在版本控制流程中使用Module referenced blocks时触发,2021.1已修复
该问题为2020.2已知缺陷,升级到2021.1及以上版本可修复
本文据 AMD 客户社区(原 Xilinx 论坛)真实报错帖整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006nZpbjSAC/after-recreate-project-rtl-blo…