Block Design 与 IP Integrator已闭环原帖 9 个回答 · 500 次浏览|器件:Vivado 2017.4(错误码:IP_Flow 19-3477)
一句话结论:官方称 2019.2 已修复,2018.3 可提供补丁,重试生成可绕过
封装后在新设计中生成输出产物报 IP_Flow 19-3477 参数更新失败,重试即通过
帖中未明确;提问者猜测与 .xci 文件 early/late 处理顺序有关,官方称 2019.2 已修复且当时无 workaround
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hplAMSAY/vivado-20174-error-when-packaging-block-design-w
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