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Versal Block Design Tcl重建时AXI NOC报错

Block Design 与 IP Integrator已闭环原帖 9 个回答 · 665 次浏览|器件：Vivado 2022.2.2 / 2023.1 / Versal（错误码：IP_Flow 19-3461）

一句话结论：补上BOARD_PART属性后问题解决

现象

用生成的tcl重建含AXI NOC的block design时出现参数越界错误

根因

上层脚本未定义BOARD_PART只定义了PART，脚本回退到基础芯片part文件导致参数不匹配

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D54U00007YVRkbSAH/versal-block-design-tcl-reconstruction-fails-on-

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相关标签：Versal · AXI_NOC · Block_Design · Tcl

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