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UltraScale+上MIPI CSI-2 TX多速率能否用DFX实现

Block Design 与 IP Integrator社区未闭环原帖 9 个回答 · 670 次浏览|器件：xczu4cg-fbvb900-2-i / Vivado DFX

一句话结论：帖中仅确认器件支持DFX，未给出可行结论

现象

需MIPI CSI-2 TX IP支持多种lane速率，考虑每种速率用独立部分比特流

根因

帖中未明确

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D5Pd00001JHReuKAH/using-xczu4cgfbvb9002i-i-need-a-mipi-csi2-tx-ip-

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相关标签：DFX · MIPI CSI-2 · UltraScale+ · Partial Reconfiguration

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