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UltraScale+ PCIe PHY Gen3收不到数据如何解决

PCIe / XDMA已闭环原帖 9 个回答 · 242 次浏览|器件：UltraScale+ PCIe PHY IP

一句话结论：补接rxpolarity信号后问题解决

现象

Gen3速率下rxdata恒为0，Gen1/2正常，仿真与板测一致

根因

连接serdes pipe接口时未连接rxpolarity，导致rxp/n极性变化时Gen3速率下PHY无法块对齐

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D5Pd00001n3QviKAE/use-ultrascale-pcie-phy-ip-config-two-x4gen3-ip-

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相关标签：PCIe · UltraScale+ · PHY · rxpolarity

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