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Artix7上MicroBlaze与MIG DDR2设计内存测试失败

Block Design 与 IP Integrator社区未闭环原帖 9 个回答 · 477 次浏览|器件：Artix-7 XC7A100TFGG484-2 / DDR2 MT47H128M16RT / MIG

一句话结论：每次内存写入会改变128位宽边界内的内存，根因未确定

现象

MicroBlaze访问DDR内存失败，32/16/8位内存测试均报失败

根因

帖中未明确

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00006hpc8HSAQ/problem-with-microblaze-block-design-with-mig-dd

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相关标签：MicroBlaze · MIG · DDR2 · Artix-7

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