IP 打包与升级社区未闭环原帖 9 个回答 · 713 次浏览|器件:UltraScale+ MPSoC xczu5evfbvb900
一句话结论:提问者倾向选 PL 侧 PCIe Integrated Block(PG213),帖中无最终验证结论。
需在两块 Ultrascale+ MPSoC 板间通过 PCIe Gen3 x4 双向高速传输数据,纠结选哪种 PCIe IP。
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hptFfSAI/pcie-integrated-block-ip-core-vs-pcie-dma-subsys
相关标签:PCIe · Integrated Block · DMA · UltraScale+
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