封装与引脚约束已闭环原帖 9 个回答 · 569 次浏览|器件:Vitis 2020.2 / XRT 2.8 / U250 xilinx_u250_gen3x16_xdma_3_1_202020_1
一句话结论:通过 TCL.PRE 在 place_design 前读取 pblock XDC 可解决,但需在 kernel 外部定义 pblock
Vitis 工程中实现工具尽量避开 pblock 放置逻辑,pblock 被忽略
打包 kernel 时父 pblock 无法被识别,created_pblock 约束会被移除
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hpQ0aSAE/pblock-in-vitis-rtl-kernel-not-working
相关标签:pblock · Vitis · RTL Kernel · VPL
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