IP 打包与升级已闭环原帖 9 个回答 · 462 次浏览|器件:Zynq XC7Z020
一句话结论:修正read_pointer范围后问题解决
仿真计数1到8,Zynq硬件只计到4或7后归零,综合后仅用3位
代码中read_pointer范围误用bit_num-1,应为NUMBER_OF_OUTPUT_WORDS;未引用高位被综合裁剪
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hpaGpSAI/master-stream-custom-ip-problem
相关标签:AXI-Stream · custom-IP · VHDL · ILA
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