时序与实现社区未闭环原帖 6 个回答 · 344 次浏览|器件:Vivado 2017.2
一句话结论:建议升级 Vivado 并用 Tcl 生成报告核对时序结果
打开 implemented design 时 Design timing summary 正常,但点击 Report Timing Summary 后 Summary 显示 failed
帖中未明确;回答者推测旧版本工具可能存在问题,并建议升级到最新版本验证
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D54U00006sbqILSAY/i-am-using-xilinx-vivado-20172-when-i-open-imple
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