封装与引脚约束已闭环原帖 9 个回答 · 436 次浏览|器件：Vitis / xilinx_u280_xdma_201920_3
一句话结论：Pblock overlap指两个pblock共享相同逻辑site，高占比不代表设计差但不推荐
Vitis工程runme.log中出现Pblock overlap信息，用户不理解其含义
帖中未明确
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00007G0seVSAR/how-to-analyze-pblock-overlap-information-mentio
相关标签：pblock · Vitis · Vivado · overlap
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