时序与实现已闭环原帖 9 个回答 · 276 次浏览|器件：原帖未注明
一句话结论：插入FF增加一个时钟周期的流水线延迟，但缩短寄存器间时序路径
长连线布线延迟不等导致时序问题，插入FF是否增加延迟
长连线布线延迟过大且不等，中间插入寄存器可打断长布线延迟，时序按寄存器到寄存器分析
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D54U00007kSjd3SAC/how-is-it-that-adding-ff-in-long-connections-hel
相关标签：timing closure · FF · routing delay · pipeline
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