DDR / MIG已闭环原帖 9 个回答 · 400 次浏览|器件：Versal VPK120（错误码：NSTD-2）
一句话结论：差分时钟需使用 DIFF_LVSTL_11 而非单端 LVSTL_11
生成 bitstream 时出现 DRC NSTD-2，部分逻辑端口 IOSTANDARD 为 UNDEFINED
差分时钟信号 LPDDR4_CLK2 使用了单端 IOSTANDARD LVSTL_11，应改用差分类型 DIFF_LVSTL_11
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D54U000071J8iVSAS/hello-i-have-a-issue-on-versal-vpk120-design-im-
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