时序与实现社区未闭环原帖 9 个回答 · 203 次浏览|器件：Vivado
一句话结论：需先写时序约束并查日志；最高频率可由slack反推，但仅为近似
综合后不知是否有timing error、如何求最高频率；生成bitstream并烧录后VIO和ILA不出现
帖中未明确
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D54U00008yquRlSAI/hello-everyone-i-am-new-in-fpga-design-i-have-wr
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