IP 打包与升级社区未闭环原帖 8 个回答 · 300 次浏览|器件:Zynq / Block Memory Generator
一句话结论:帖中未给出结论,问题未解决
expected_rdata与M_AXI_RDATA不一致触发错误,且不知PL如何访问数据
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006iHuUsSAK/custom-ip-with-master-axi-port-transfering-data-
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