PR 流程布线拥塞导致布线验证失败
实现 Place / Route / Opt / Timing 社区未闭环 Vivado 2019.1 / UltraScale+
一句话结论:建议先在非 PR 流程验证这些时钟网络布线是否正常
实现阶段出现布线层拥塞严重警告并最终报错
[Route 35-451] Routing/Distribution Layer congestion detected on net qsfp1_instance/inst/i_core_gtwiz_userclk_tx_inst_0/CLK
帖中未明确
建议先在非 PR 流程验证这些时钟网络布线是否正常
本文据 AMD 客户社区(原 Xilinx 论坛)真实报错帖整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hpK1SSAU/primpl-error-route-35451-routi…