Block Design 与 IP Integrator已闭环原帖 9 个回答 · 276 次浏览|器件:PG232 / MIPI CSI-2 Receiver IP
一句话结论:C-PHY下Line Rate参数指符号率,非D-PHY的每lane比特率
用户困惑PG232 IP GUI中C-PHY的Line Rate是信号变化率还是带宽
PG232 IP GUI在C-PHY模式下仍将字段标为Line Rate (Mb/s),实际按符号率(Msps)处理,见PG435确认
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D5Pd000018VcgpKAC/what-is-an-actual-signal-changing-rate-for-pg232
相关标签:MIPI CSI-2 · C-PHY · PG232 · line rate
就这个问题继续问 AI → ← 返回 AMD 社区问答速查