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Vitis 2020.1加速示例在Ubuntu 18.04上构建失败

Linux 系统与内核社区未闭环原帖 9 个回答 · 739 次浏览|器件：Vitis 2020.1 / Ubuntu 18.04 / Zynq Ultrascale+ MPSoC第三方板

一句话结论：HLS IP生成问题经时钟修改后解决，但主工程仿真与硬件构建仍失败，根因未明确

现象

Emulation-HW与Hardware构建均失败，加载qemu时程序停止，Hardware构建报引脚约束相关错误

根因

帖中未明确；仅提到vitis_hls.log显示HLS IP生成问题与系统时钟有关，修改后IP生成成功，但主工程仍失败

可尝试的处理步骤

检查vitis_hls.log（路径：home/opencl/opencl_project/alinx_custom_pkg/vadd/Emulation-HW/binary_container_1.build/krnl_vadd/krnl_vadd/vitis_hls.log）
根据vitis_hls.log中系统时钟相关问题进行修改
尝试Emulation-HW、Hardware等不同构建模式
查看Hardware构建日志vadd_Hardware.build.ui

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E000075yUP4SAM/vitis-acceleration-example-failed-with-vitis-202

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相关标签：Vitis · Zynq-UltraScale+ · OpenCL · HLS

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