PCIe / XDMA社区未闭环原帖 9 个回答 · 1.36K 次浏览|器件:VC709 / xc7vx690tffg1761-2 / AXI Bridge for PCI Express Gen3 Subsystem v1.1
一句话结论:BAR2配置与PF0_BAR_CONTROL不一致,需确认修改方式
仿真中RP发送0x6000_0000至0x9000_0000地址,BAR2仅1GB但系统访问2个DIMM
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hpaIySAI/pci-express-problem-maximum-bar-area-in-64bit-sy
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