封装与引脚约束社区未闭环原帖 8 个回答 · 378 次浏览|器件:Vivado / IP Packager
一句话结论:帖中未给出明确结论,仅提出疑问
IP打包时不确定是否该提供时钟约束,独立测试IP级约束时无法获取时钟
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006iHwIPSA0/packaged-ip-constraint-file-xdc-without-clocks
相关标签:Vivado · IP_Packager · XDC · timing_constraints
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