Block Design 与 IP Integrator已闭环原帖 5 个回答 · 391 次浏览|器件:A53/R5,standalone无OS
一句话结论:关闭两侧cache后共享内存通信可用,但原因未明
A53向R5发送数据,R5域中数据始终不变
帖中未明确;提问者最终通过关闭R5和A53两侧cache解决,但称按理不应需要
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D54U00008Zwo8YSAR/i-have-shared-memory-between-the-a53-and-r5-proc
相关标签:shared-memory · A53 · R5 · cache
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