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AXI Bridge for PCIe Gen3 根端口无法与端点通信

PCIe / XDMA已闭环原帖 9 个回答 · 233 次浏览|器件：Kintex Ultrascale / AXI Bridge for PCIe Gen 3 IP

一句话结论：修正 BAR upper 地址后根端口与端点恢复通信

现象

链路已 up 且双方进入 L0，但根端口 S_AXI 写不产生 TLP、无法到达端点

根因

示例设计中寄存器 BAR upper 被设为 32'b1000_0000 而非 32'b0000_0000，导致内存空间不兼容

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D5Pd00001HiDDwKAN/i-am-using-the-axi-bridge-for-pcie-gen-3-ip-to-i

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相关标签：PCIe · AXI_Bridge · Root_Port · BAR

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