IP 打包与升级社区未闭环原帖 9 个回答 · 230 次浏览|器件:原帖未注明
一句话结论:帖中未给出映射方法,仅建议考虑AXI BRAM Controller
自定义IP读写外部BRAM时,不知如何在AXI4 Master接口内映射逻辑的输入输出端口
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D54U00007397M5SAI/how-can-i-map-input-and-output-of-my-custom-ip-w
相关标签:AXI4 · custom IP · BRAM · mapping
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