FSBL 与启动镜像社区未闭环原帖 9 个回答 · 625 次浏览|器件:Vitis / ZYNQMP SoC / 客户板
一句话结论:建议先用zynqmp_dram_test验证DDR是否正常,根因未确认
Vitis运行System Project Debug时弹出FSBL退出断点未在60秒等待时间内命中的错误
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D54U00006nUVjOSAW/exit-breakpoint-of-fsblxfsblexit-is-not-hit-with
相关标签:FSBL · XFsbl_Exit · Vitis · ZYNQMP
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