PCIe / XDMA社区未闭环原帖 4 个回答 · 121 次浏览|器件:Zynq MPSoC / Vitis Embedded Development & SDK
一句话结论:帖中未给出具体实现步骤或结论
裸机应用使用A53四核与R5双核并行多任务,需加入异常和错误处理
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D5KZ00000yMvmX0AS/exceptions-and-error-handling-in-zynq-mpsoc-for-
相关标签:Zynq MPSoC · bare metal · exception handling · Vitis
就这个问题继续问 AI → ← 返回 AMD 社区问答速查