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加入AXI4-Stream Broadcaster后循环DMA为何失败？

DMA 传输社区未闭环原帖 6 个回答 · 94 次浏览|器件：xaxidma_example_sgcyclic_intr.c

一句话结论：帖中未给出根因或解决方案，仅描述现象与观察。

现象

标准设计循环DMA测试成功；在M_AXIS_MM2S与FIFO间加Broadcaster后测试失败，仅处理两个BD后不再收到中断。

根因

帖中未明确

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D5KZ00000zTPap0AG/why-does-cyclic-dma-fails-after-a-small-modifica

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相关标签：AXI DMA · cyclic DMA · AXI4-Stream · interrupt

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