DMA 传输社区未闭环原帖 8 个回答 · 208 次浏览|器件:Vitis_HLS / Vivado / AXI DMA
一句话结论:帖中仅提出问题,未给出解决 TLAST 缺失与死锁的方案
Vitis_HLS 生成的流接口 IP 只有 TDATA/TVALID/TREADY,无 TLAST,接 AXI DMA 会死锁
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D54U00008Ln0dASAR/tlast-not-getting-generated-for-hlsstreamapuint-
相关标签:Vitis_HLS · AXI_DMA · TLAST · hls_stream
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