DMA 传输已闭环原帖 9 个回答 · 374 次浏览|器件:Vivado 2015.2/2015.3 / AXI DMA v7.1
一句话结论:尝试优化与升级均未成功,最终降低 DMA 时钟后工作正常
使能 Scatter Gather 后 DMA 在 150MHz 下时序不满足,SG 信号路径有 7 到 13 级逻辑
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00007FSYqbSAH/timing-closure-issue-axi-dma-ip-scatter-gather-m
相关标签:AXI DMA · Scatter Gather · timing closure · Vivado
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