DMA 传输已闭环原帖 9 个回答 · 676 次浏览|器件：Vivado 2017.4 / AXI DMA
一句话结论：属预期行为，应在软件启动DMA后再发送实际数据
程序刚启动、尚未操作DMA读数据时，S_AXIS_S2MM的tready已为高，FIFO写入8个数据时TVALID拉高持续4周期后tready被拉低
帖中回复称该行为属预期：DMA驱动初始化时会复位内核，初始化之前到达的数据无效
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00006hpPHLSA2/the-tready-in-saxiss2mm-interface-of-axi-dma-hav
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