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知识库›AMD 社区问答速查›AXI DMA流数据宽度不匹配如何解决

AXI DMA流数据宽度不匹配如何解决

DMA 传输已闭环原帖 9 个回答 · 1.06K 次浏览|器件：Vivado 2017.4 / Zynq（错误码：[BD 41-237]）

一句话结论：用AXI-4 Stream Data Width Converter并正确设置端口宽度可解决

现象

Validate Design报TDATA_NUM_BYTES不匹配，S2MM为4字节而自定义IP为2字节

根因

帖中未明确

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00006hpmijSAA/problem-with-axi-dma-stream-data-width-bd-41237-

Vivado 报错词典解读

这条帖子的错误码在词典里有独立词条，含现象、根因与可执行步骤：

ERROR: [BD 41-237]
write_bd_tcl 生成的脚本导致 FREQ_HZ 不匹配

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相关标签：AXI DMA · AXI Stream · Vivado · Width Converter

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