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AXI DMA传输丢失部分数据如何解决？

DMA 传输已闭环原帖 9 个回答 · 824 次浏览|器件：ZCU102 MPSoC / Vivado HLS / AXI DMA

一句话结论：需在HLS流末尾添加tlast位以正确标记数据包结束

现象

XAxiDma_SimpleTransfer()似乎丢弃部分数据流

根因

HLS流输出未设置tlast位，导致DMA无法识别数据包结尾

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00006hpli7SAA/need-help-axi-dma-transferreceive-fails-to-trans

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相关标签：AXI DMA · HLS · tlast · ZCU102

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