Block Design 与 IP Integrator社区未闭环原帖 9 个回答 · 1.85K 次浏览|器件:Vivado 2019.2/2020.2/2021.1(错误码:BD 41-927)
一句话结论:警告暂可忽略;有回复建议在IP packager中为时钟端口设置FREQ_HZ
打包自定义IP的s00_axi_aclk引脚报BD 41-927警告,PHASE=0.0,功能似无影响
帖中未明确
本文基于 AMD 客户社区(原 Xilinx 论坛)真实问答整理为中文要点,非原文转载;技术细节以原帖与 AMD 官方文档为准。
原帖:https://adaptivesupport.amd.com/s/question/0D52E00006hpPXKSA2/ip-integrator-bd-cell-does-not-accept-parameter-
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