Vivado 报错与许可已闭环原帖 9 个回答 · 602 次浏览|器件：Vivado / ZCU102
一句话结论：将Source设为No buffer后警告消除，设计在硬件上工作正常
Vivado报Methodology critical warning：主时钟定义在不当引脚、时钟树重复定义
Clocking Wizard输入源设为单端时钟能力引脚，使clk_in1被当作PS pl_clk0下游的新主时钟
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D5Pd000010FE8sKAG/how-to-resolve-methodology-critical-warnings-for
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