驱动与中断社区未闭环原帖 8 个回答 · 700 次浏览|器件：ZCU208 / xczu48dr0ffvg1517-2-e-es1 / CLK104 / RFDC
一句话结论：软件重写相同PLL配置可消除bitstream配置带来的频率误差，根因待查
bitstream配置RFDC PLL后出现频率误差，用xrfdc驱动重写相同配置后误差消失
帖中未明确
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00006hpS5NSAU/frequency-error-when-rfdc-plls-configured-by-bit
该问题涉及的器件系列（点进去看同系列其他踩坑记录）：
Zynq UltraScale+ / MPSoC →相关标签：RFDC · PLL · ZCU208 · CLK104
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