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AXI Ethernet MAC层环回如何连接？

Block Design 与 IP Integrator已闭环原帖 9 个回答 · 450 次浏览|器件：ZCU102 / AXI Ethernet / IP Integrator

一句话结论：MAC环回需在axis_*xd侧实现，gmii_*xd环回属于PHY环回

现象

gmii_txd直连gmii_rxd实现时报告非IO buffer无法连接IDELAY的IDATA引脚

根因

gmii_*xd信号属于PHY侧，MAC层环回应在axis_*xd信号侧进行

可尝试的处理步骤

本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D52E00006hphCDSAY/error-during-loopback-in-the-axi-ethernet-while-

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相关标签：AXI Ethernet · loopback · ZCU102 · IP Integrator

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