Vivado 报错与许可社区未闭环原帖 9 个回答 · 647 次浏览|器件：Vivado 2025.2 / Zynq UltraScale+ XCZU7EV / MIPI CSI-2 Rx Subsystem 6.0（错误码：Vivado 12-5201）
一句话结论：帖中未给出最终解决方案，提问者考虑忽略该警告或注释掉相关约束
综合/实现时IP自动生成的XDC报set_clock_groups严重警告
IP的XDC中get_clocks -of_objects [get_ports video_aclk]引用的时钟clk_pl_1在IP的XDC之后才定义，导致约束无法引用该时钟
本文基于 AMD 客户社区（原 Xilinx 论坛）真实问答整理为中文要点，非原文转载；技术细节以原帖与 AMD 官方文档为准。
原帖：https://adaptivesupport.amd.com/s/question/0D5Pd00001VP5NDKA1/critical-warning-during-mipi-csi2-rx-subsystem-s
相关标签：Vivado · MIPI_CSI2_Rx · XDC · set_clock_groups
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