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hdl-modules

工具链 hdl-modules

A collection of reusable, high-quality, peer-reviewed VHDL building blocks.

EDA、仿真、综合与布局布线类工具,属于 FPGA 开发流程的基础设施。

该项目主题覆盖 altera、amd、asic、asynchronous-fifo、axi、axi-lite、cdc、clock-domain-crossing 等方向。

本页为仓库信息自动同步页,每周随 GitHub 数据更新;深度评测与实测文章见下方同类项目。

Star220
Fork41
主要语言VHDL
开源许可BSD-3-Clause
最近提交2026-11-02
仓库地址https://github.com/hdl-modules/hdl-modules
项目主页https://hdl-modules.com
前往 GitHub 查看源码与 README

仓库标签

alteraamdasicasynchronous-fifoaxiaxi-litecdcclock-domain-crossing

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