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chisel

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Chisel: A Modern Hardware Design Language

与 FPGA 生态相关的开源工程。

该项目主题覆盖 chip-generator、chisel、chisel3、firrtl、rtl、scala、verilog 等方向。

本页为仓库信息自动同步页,每周随 GitHub 数据更新;深度评测与实测文章见下方同类项目。

Star4,830
Fork666
主要语言Scala
开源许可Apache-2.0
最近提交2026-11-06
仓库地址https://github.com/chipsalliance/chisel
项目主页https://www.chisel-lang.org/
前往 GitHub 查看源码与 README

仓库标签

chip-generatorchiselchisel3firrtlrtlscalaverilog

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